ペンティアム（オリジナル）

ペンティアム（i586）
一般情報
発売1993年3月22日 （1993年3月22日）
製造中止1999年7月15日（受注および出荷）[ 1 ] 2001年12月31日（生産終了および生産終了）[ 2 ] （1999年7月15日） （2001年12月31日）
販売元インテル
デザイン：インテル
共通メーカー
  • インテル
製品コード80501 (P5) 80502 (P54C、P54CQS、P54CS) 80503 (P55C、ティラムック)
パフォーマンス
最大CPUクロックレート60～300MHz
FSB速度50MHz～66MHz
物理的仕様
トランジスタ
コア
  • 1
ソケット
キャッシュ
L1キャッシュ16～32 KB
L2キャッシュ最大512 KiB [ 4 ]（マザーボード上）
アーキテクチャと分類
テクノロジーノード800 nm～250 nm
マイクロアーキテクチャP5
命令セットx86-16、IA-32
拡張機能
製品、モデル、バリエーション
コア名
  • P5
  • P54C
  • P54CQS
  • P54LM
  • P54CS
  • P55C
  • P55LM
  • ティラムック
  • P24T
モデル
歴史
前任者i486
後継者P6、Pentium II、Pentium III (SSE 後継)
サポート状況
サポートされていません

Pentium （ i586またはP5 Pentiumとも呼ばれる）は、1993年3月22日にIntelによって発表されたマイクロプロセッサである。これは、Pentiumブランドを使用した最初のCPUである。 [ 5 ] [ 6 ] x86 （ 8086 ）互換プロセッサラインの 第5世代と見なされ、 [ 7 ] i486の後継であり、その実装とマイクロアーキテクチャは社内でP5と呼ばれていた。

Intel i486と同様に、Pentiumは32ビットi386と命令セット互換性があります。i486と非常によく似たマイクロアーキテクチャを採用していますが、デュアル整数パイプライン設計と、前世代機よりも10倍高速とされるより高度な浮動小数点ユニット（FPU）を実装できるほど拡張されています。 [ 8 ]

1995年11月、Pentiumの後継としてPentium Proが発表されました。1996年10月には、オリジナルのPentiumと同じ基本的なマイクロアーキテクチャをベースに、MMX命令セット、大容量キャッシュ、その他の機能強化を加えたPentium MMX [9]が発表されました。Intelは、1997年のPentium IIの発売後、低価格帯の選択肢として販売されていたオリジナルのPentium (P5)プロセッサの製造を中止しました。Pentiumシリーズは徐々にCeleronプロセッサに置き換えられ、Celeronも80486ブランドの役割を引き継ぎました。新モデルは1999年7月まで発表され続けました。[ 1 ]

インテルは2001年12月31日、 Windows 95およびそれ以前のバージョンのWindowsのサポートが終了したのと同じ日に、オリジナルのPentiumプロセッサのサポート終了を正式に宣言しました。[ 2 ]

概要

P5ペンティアムは初のスーパースカラx86プロセッサであり、2つの命令を同時に実行できることが多かった。[ 10 ]これを実装するために使用されたいくつかの技術は、初期のスーパースカラIntel i960 CA（1989）をベースにしていたが、その他の詳細はP5設計のために独自に考案された。また、パイプライン方式で複雑なx86エンコーディングに対処する戦略など、大部分はi386またはi486からコピーされた。[ 11 ] i486と同様に、ペンティアムは、特定の命令または命令の一部に応じて、最適化されたマイクロコードシステムとRISCのような技術の両方を使用していた。デュアル整数パイプライン設計は、一部の学者やRISCの競合他社によって、 CISC命令セットでは実装不可能であると主張しられていたものである。

その他の主要な機能としては、再設計され大幅に高速化された浮動小数点演算ユニット、64ビットのバーストモード・データバス（内部および外部）、独立したコードキャッシュとデータキャッシュ、その他多くのパフォーマンス向上のための技術と機能が挙げられる。256ビットの内部データバスとライトバックキャッシュを搭載している。[ 12 ] IntelのSLアーキテクチャ以降に実装されているシステム管理モードも搭載している。[ 13 ]

66MHzペンティアムプロセッサは112 V1.1 Dhrystone MIPSで動作し、SPECint 92の評価は64.5、SPECfp 92の評価は56.9、iCOMP indexの評価は567です。60MHz版と66MHz版の性能差は約10%です。[ 14 ]

P5はi486と比較してマルチプロセッシングのサポートが優れており、IBMメインフレーム・コンピュータと同様のハードウェアサポートを備えた初のx86 CPUです。IntelはIBMと協力し、この機能を定義し、P5マイクロアーキテクチャに組み込みました。この機能は、以前のx86世代や競合他社のx86プロセッサには存在しませんでした。

デュアルパイプラインの性能を最大限に引き出すため、一部のコンパイラは命令レベルの並列性をより効果的に活用するように最適化されましたが、すべてのアプリケーションが再コンパイルによって大幅なメリットを得られるわけではありません。しかしながら、高速FPUはi486やi387と比較して、浮動小数点演算性能を常に大幅に向上させました。Intelは、開発ツールベンダー、ISV、オペレーティングシステム（OS）ベンダーと協力し、製品の最適化にリソースを費やしました。

Intel Pentium A80501 66 MHz SX950 ダイイメージ

競合製品としては、スーパースカラーのPowerPC 601 (1993)、SuperSPARC (1992)、DEC Alpha 21064 (1992)、AMD 29050 (1990)、Motorola MC88110 (1991)、Motorola 68060 (1994) などがあり、そのほとんどはスーパースカラーのインオーダー デュアル命令パイプライン構成を採用していました。また、スーパースカラーではないMotorola 68040 (1990) とMIPS R4000 (1991)もありました。

語源

「Pentium」という名前は、もともとギリシャ語の「5」を意味するpente ( πέντε ) に由来しており、これは Intel の 80x86 プロセッサ (8086 から 80486) の以前の数値命名規則を参照しており、その規則に従ってプロセッサが 80586 と命名されていたため、ラテン語の末尾に-iumが付けられています。

発達

P5マイクロアーキテクチャは、386と486を設計した同じサンタクララチームによって設計された。[ 15 ]設計作業は1989年6月に開始された。[ 16 ]チームは、RISCとCISC技術の収束となるスーパースカラRISCアーキテクチャを使用することを決定し、 [ 17 ]オンチップキャッシュ、浮動小数点、分岐予測を備えた。[ 18 ]当時マイクロプロセッサ製品グループの副社長兼マイクロプロセッサ部門5/7のジェネラルマネージャであったVinod Dhamは、このRISC技術を既存のx86アーキテクチャに使用して、他の市場と競合するという構想を思いついた。[ 19 ]彼らのパフォーマンス目標は、既存のIntel486 CPUと比較してFPUを3倍と5倍に向上させることだった。[ 20 ] 予備設計は1990年に初めてシミュレーションに成功し、続いて設計のレイアウトが行われた。主要なオペレーティングシステムと多くのアプリケーションが起動して実行される、約 1 億クロック サイクルのプレシリコン検証テストが必要でした。プレシリコン シミュレーション プログラムを実行するために、 Quickturn Systems Inc. のソフトウェアを使用する必要がありましたが、これは以前の技法よりも 30,000 倍高速でした。[ 21 ] 1990 年後半までに、計画した機能がダイに収まらないことがわかり、パフォーマンスを犠牲にすることなく意図した設計に収まるように回路機能を再設計する必要がありました。1991 年の春、パフォーマンスに影響を与えることなく、Dham がサイズと機能に満足するまで、ダイは再度スリム化されました。エンジニアのグループは、設計された機能を検証するために数百のテストを実行し、設計を検証するために 5,000 の異なる変数を実行しました。コレクション内の 14 の回路基板とケーブルのうち、開発中も含め手元にあるすべてのオペレーティングシステムを使用しても、バグはほんのわずかしか見つかりませんでした。[ 22 ] 1992年2月までに設計はテープアウトされ、1992年4月までに完了し、その時点でベータテストが開始されました。[ 23 ] [ 24 ] 次の数ヶ月で、設計はインテルのマスクオペレーションに送られ、オレゴンのFab 5で処理されるマスクレイアウトに変換されました。[ 25 ] 1992年半ばまでに、P5チームには200人のエンジニアがいました。[ 16 ] : 89 インテルは当初、1992年6月のPC Expo展示会でP5のデモを行い、1992年9月に正式にプロセッサを発表する予定だったが[ 26 ]、設計上の問題によりデモは中止となり、チップの公式発表は1993年春まで延期された。[ 27 ] [ 28 ] ペンティアムを搭載した最初のコンピュータシステムは1993年夏に登場し、その最初のものはアドバンストロジックリサーチとそのEvolution Vワークステーションで、1993年7月の第1週にリリースされた。[ 29 ] [ 30 ] [ 31 ]

オリジナルの386の主任建築家であるジョン・H・クロフォードは、建築チームを率いたドナルド・アルパートと共にP5の設計を共同で担当した。 [ 32 ]ドロール・アヴノンはFPUの設計を担当した。[ 33 ]ヴィノド・K・ダムはP5グループのゼネラルマネージャーであった。[ 16 ] : 90

インテルのLarrabeeマルチコアアーキテクチャプロジェクトは、P5コア（P54C）から派生したプロセッサコアを使用し、マルチスレッド、64ビット命令、16バイト幅のベクトル処理ユニットが追加されています。[ 34 ]インテルの初期のAtomプロセッサコアで採用された低消費電力のBonnellマイクロアーキテクチャも、P5と同様のインオーダーデュアルパイプラインを使用しています。[ 35 ]

インテルは1991年に「386」の商標をめぐる商標紛争で敗訴したため、586ではなくPentiumという名称を使用しました。この紛争では、裁判官が「386」という数字は一般名義であるとの判決を下しました。同社は、数字ではない新しい名称を考案するために、Lexicon Branding社に依頼しました。[ 36 ]

i486からの改良点

P5 マイクロアーキテクチャは、従来の i486 アーキテクチャに比べていくつかの重要な進歩をもたらします。

  • パフォーマンス：
    • スーパースカラ・アーキテクチャ – Pentiumには2つのデータパス（パイプライン）があり、多くの場合、1クロックサイクルあたり2つの命令を実行できます。メインのパイプライン（U）はあらゆる命令を処理でき、もう1つのパイプライン（V）は最も一般的な単純な命令を処理できます。最初の命令はUパイプラインに送られ、次の命令はVパイプラインに送られます。両方のパイプラインには、それぞれ独自のALU、アドレス生成回路、そしてデータキャッシュへのインターフェースが搭載されています。[ 37 ]縮小命令セット・コンピュータ（RISC）の支持者の中には、「複雑な」x86命令セットは、厳密にパイプライン化されたマイクロアーキテクチャではおそらく実装できず、ましてやデュアルパイプライン設計では実現不可能だと主張する者もいました。486とPentiumは、これが実際に可能であり、実現可能であることを実証しました。
    • 64ビットバーストモード外部データバスは、メモリアクセスごとに読み書き可能な情報量を2倍にするため、Pentiumは80486よりも高速にコードキャッシュをロードできます。また、64ビットおよび80ビットのx87 FPUデータへのアクセスと保存も高速化します。このCPUは内部的に32ビット幅でデータを処理します。メモリへの外部データは64ビット幅で、1バスサイクルで転送されるデータ量が2倍になります。このCPUには複数の種類のバスサイクルがあり、その中には1バスサイクルで256ビット分のデータをデータキャッシュにロードするバーストモードも含まれます。このデータ幅により、メモリとの間で最大528MB/秒のデータ転送が可能です。この速度は、50MHzのIntel486 DX CPUのピーク転送速度の3倍に向上しています。[ 38 ]
    • 両方の 8K バイトのオンチップ キャッシュでコードとデータを分離することにより[ 39 ]、486 と比較してフェッチとオペランドの読み書きの競合が軽減されます。1 セットは命令用で、もう 1 セットはデータ用です。[ 40 ] アクセス時間と実装コストを削減するために、486 の単一の 4 ウェイ キャッシュではなく、両方とも2 ウェイ アソシアティブです。キャッシュの 32 バイト ラインのペアを使用して、64 ビット幅を 4 チャックのバースト長に一致させます。このキャッシュ管理は、MESIキャッシュ一貫性プロトコルに準拠しています。[ 41 ] Pentium の関連する拡張機能は、コード キャッシュが 2 つのキャッシュ ラインに分割されている場合でも (最悪の場合でも少なくとも 17 バイト)、コード キャッシュから連続したブロックを読み取ることができることです。
    • はるかに高速な浮動小数点ユニット。このコンポーネントには、クロックサイクルごとに少なくとも1つの浮動小数点演算を実行する8ステージのパイプラインが組み込まれています。このパイプラインの最初の4ステージは整数部分を使用し、最後の4ステージは2ステージの浮動小数点演算実行、丸め、結果のレジスタファイルへの書き込み、およびエラー報告です。このユニットには、これらの共通演算の速度を前世代のCPUの3倍にする新しいアルゴリズムもあります。[ 42 ] 一部の命令、特にFMULでは、80486 FPUよりも最大15倍のスループットを実現し、大幅な改善が見られました。Pentiumは、通常の（算術またはロード/ストア）FPU命令と並列にFXCH ST(x)命令を実行することもできます。
    • 4 入力アドレス加算器により、Pentium は 80486 と比較してアドレス計算のレイテンシをさらに短縮できます。Pentium は、セグメント ベース+ベース レジスタ+スケール レジスタ+イミディエイト オフセットを使用した完全なアドレス指定モードを 1 サイクルで計算できます。486 には 3 入力アドレス加算器しかないため、このような計算を 2 サイクルに分割する必要があります。
    • マイクロコードは両方のパイプラインを使用することで、REP、MOVSWなどの自動繰り返し命令を1クロックサイクルごとに1回の反復処理を実行できます。一方、80486では反復処理ごとに3クロックが必要でした（初期のx86チップでは486よりも大幅に多くのクロックが必要でした）。また、デコード段階における最初のマイクロコードワードへのアクセスの最適化により、特に最も一般的な形式や典型的なケースにおいて、頻繁に実行されるいくつかの命令の実行速度が大幅に向上します。例としては、（486→Pentium、クロックサイクル数）CALL（3→1）、RET（5→2）、シフト/ローテート（2–3→1）などがあります。
    • より高速で、完全にハードウェア ベースの乗算器により、MUL や IMUL などの命令は 80486 よりも数倍高速 (かつ予測可能) になり、実行時間は 32 ビット オペランドの場合は 13 ～ 42 クロック サイクルから 10 ～ 11 クロック サイクルに短縮されます。
    • 仮想 8086 モードを高速化するための仮想化割り込み。
    • 小さなキャッシュブロックを含む分岐ターゲットバッファ方式を用いた動的分岐予測。エラトステネスのふるいベンチマーク法を用いると、Intel486 CPUでは6クロックサイクルかかるのに対し、このCPUでは2クロックサイクルで実行できる。[ 43 ]
  • その他の機能:
    • プロセッサベースのデバッグ ポートの導入によりデバッグ機能が強化されました (開発者マニュアル Vol 1 の「Pentium プロセッサのデバッグ」を参照)。
    • L1キャッシュパリティチェックなどの強化されたセルフテスト機能（開発者マニュアル第1巻の「キャッシュ構造」を参照）。その他の内蔵機能としては、 CPUへの外部接続をテストするためのIEEE 1149.1準拠のアクセスアーキテクチャや、ソフトウェアから参照可能なレジスタとプロセッサ状態にアクセスするためのプローブモードなどがあります。[ 44 ]
    • 新しい命令: CPUID、CMPXCHG8B、RDTSC、RDMSR、WRMSR、RSM。
    • テスト レジスタ TR0 ～ TR7 とそれらにアクセスするための MOV 命令は削除されました。
  • 後期のPentium MMXには、マルチメディアアプリケーション向けに開発された基本的なSIMD（整数・単一命令・複数データ）命令セット拡張であるMMX命令セットも追加されました。MMXは、高速なコンテキストスイッチを可能にするためにレジスタが再利用されていたため、 x87 FPU命令と同時に使用することはできませんでした。より重要な機能強化としては、命令キャッシュとデータキャッシュのサイズが倍増したことと、パフォーマンス向上のためのマイクロアーキテクチャへのいくつかの変更が挙げられます。

Pentiumは1億MIPS（1秒あたり1億命令以上）を実行できるように設計されており、 [ 45 ] 75MHzモデルは特定のベンチマークで126.5MIPSに到達した。[ 46 ] Pentiumアーキテクチャは、一般的なベンチマークでクロックサイクルあたり486プロセッサの2倍弱の性能を提供した。最速の80486パーツ（わずかに改良されたマイクロアーキテクチャと100MHz動作）は、第1世代のPentiumとほぼ同等の性能であり、AMD Am5x86は、その名前にもかかわらず実際には486クラスのCPUであるが、純粋なALU性能に関してはPentium 75とほぼ同等であった。

誤植

60～66MHzのP5 Pentiumの初期バージョンには、浮動小数点演算ユニットに問題があり、一部の除算演算で誤った（しかし予測可能な）結果が出るという問題がありました。この欠陥は1​​994年にバージニア州リンチバーグ大学のトーマス・ナイスリー教授によって発見され、Pentium FDIVバグとして広く知られるようになり、Intelにとって大きな痛手となりました。同社は欠陥プロセッサを交換するための交換プログラムを立ち上げました。

1997年には、悪意のあるプログラムが特別な権限を持たずにシステムをクラッシュさせる可能性がある新たなエラッタ、「F00Fバグ」が発見されました。P5シリーズのすべてのプロセッサが影響を受け、修正版はリリースされませんでしたが、当時のオペレーティングシステムにはクラッシュを防ぐための回避策がパッチとして適用されました。

コアとステッピング

Pentiumは、1990年代半ばのIntelのパーソナルコンピュータ向け主力マイクロプロセッサでした。オリジナルの設計は新しいプロセスで再実装され、競争力を維持し、ポータブルコンピュータなどの特定の市場に対応するために新機能が追加されました。その結果、P5マイクロアーキテクチャには複数のバリエーションが存在しました。

P5

Intel Pentium マイクロアーキテクチャ

最初のPentiumマイクロプロセッサコアのコードネームは「P5」でした。製品コードは80501（初期ステッピングQ0399では80500）でした。ソケット4を使用し、それぞれ60MHzと66MHzで動作するように指定された2つのバージョンがありました。この最初のPentium実装は、273ピンPGAフォームファクタでリリースされ、5V電源で動作しました（通常のトランジスタ-トランジスタロジック（TTL）互換性要件から派生）。310万個のトランジスタを搭載し、16.7 mm x 17.6 mm、面積は293.92 mm 2でした。[ 47 ] 800 nmの3層メタルバイポーラ相補型金属酸化膜半導体（BiCMOS ）プロセスで製造されました。[ 48 ] [ 49 ] 5ボルト設計では、直後のモデルと比較すると、その動作周波数に対して比較的高いエネルギー消費量となりました。

P54C

Intel Pentium P54C ダイショット

P5の後継として1994年にP54C (80502)が登場し、3.3ボルト電源で75、90、100MHzで動作するバージョンが用意された。ソケット5への移行を象徴するこのプロセッサは、3.3ボルトで動作する最初のPentiumプロセッサであり、消費電力は低減したが、マザーボード上で電圧調整が必要になった。より高クロックの486プロセッサと同様に、このプロセッサからは内部クロック乗算器が採用され、内部回路を外部アドレスバスおよびデータバスよりも高い周波数で動作させるようになった。これは、物理的な制約により外部周波数を上げるのがより複雑で面倒なためである。また、双方向マルチプロセッシングを可能にし、統合ローカルAPICと新しい電力管理機能を備えていた。BiCMOSプロセスで製造されたが、定義の違いにより500nmプロセスとも600nmプロセスとも呼ばれている。 [ 50 ]

P54CQS

P54Cの後継として、1995年初頭に120MHzで動作するP54CQSが登場した。350nm BiCMOSプロセスで製造され、 350nmプロセスで製造された最初の商用マイクロプロセッサとなった。[ 50 ]トランジスタ数はP54Cと同一で、より新しいプロセスであるにもかかわらず、ダイ面積も同一であった。チップはワイヤボンディングを使用してパッケージに接続されていたが、ワイヤボンディングではチップのエッジに沿った接続しかできなかった。チップを小型化するには、ワイヤの長さに制限があり、チップのエッジがパッケージのパッドから遠ざかるため、パッケージの再設計が必要であった。解決策は、チップのサイズを同じに保ち、既存のパッドリングを保持し、Pentiumのロジック回路のサイズのみを縮小して、より高いクロック周波数を実現することであった。[ 50 ]

P54CS

P54CQSの後継として、133、150、166、200MHzで動作するP54CSが登場し、Socket 7を導入しました。330万個のトランジスタを搭載し、面積は90mm² 、 4層の相互接続を備えた350nm BiCMOSプロセスで製造されました。

P24T

486システム向けのP24T Pentium OverDriveは1995年にリリースされました。これは3.3V 600nmバージョンをベースにしており、63MHzまたは83MHzのクロック周波数を採用していました。Socket 2 / 3を採用していたため、486マザーボードの32ビットデータバスと低速なオンボードL2キャッシュを補うために、いくつかの変更が必要でした。そのため、32KBの L1キャッシュ（P55C以前のPentium CPUの2倍）が搭載されました。

P55C

Intel Pentium MMX マイクロアーキテクチャ
Pentium MMX 166 MHz（カバーなし）

P55C（または80503）は、イスラエルのハイファにあるインテル研究開発センターで開発されました。Pentium with MMX Technology（通常はPentium MMXと呼ばれます）として販売されました。P5コアをベースとしていましたが、デジタルメディアデータのエンコードやデコードといったマルチメディアタスクのパフォーマンス向上を目的とした、57個の新しい「MMX」命令セットを搭載していました。Pentium MMXシリーズは1996年10月22日に発表され、1997年1月に発売されました。[ 51 ]

新しい命令は、新しいデータ型、すなわち8つの8ビット整数、4つの16ビット整数、2つの32ビット整数、または1つの64ビット整数からなる64ビットパックベクターで動作します。例えば、PADDUSB（Packed ADD Unsigned Saturated Byte）命令は、それぞれ8つの8ビット符号なし整数を含む2つのベクターを要素ごとに加算します。オーバーフローする加算は飽和し、1バイトで表現できる最大の符号なし値である255が生成されます。これらの特殊な命令を使用するには、通常、プログラマによる特別なコーディングが必要です。

コアの他の変更点としては、リターンスタック（Cyrix 6x86で初めて採用）と並列性の向上による6段パイプライン（P5では5段）、改良された命令デコーダ、4ウェイ連想性を備えた16KB L1データキャッシュ + 16KB L1命令キャッシュ（P5では2ウェイの8KB L1データ/命令）、どちらのパイプラインでも使用できる4つの書き込みバッファ（P5では各パイプラインに1つずつ対応）、およびPentium Proから引き継いだ512エントリバッファ（ P5では256エントリバッファ）を備えた改良された分岐予測器などがあります。[ 52 ] [ 53 ]

このチップは450万個のトランジスタを搭載し、面積は140 mm 2であった。280 nm CMOSプロセスで製造され、金属ピッチは従来の350 nm BiCMOSプロセスと同じであったため、Intelはトランジスタ密度が近いことから「350 nm」と呼んだ。[ 55 ]このプロセスは4層の相互接続構造を持つ。[ 55 ]

P55CはSocket 7との互換性を維持していましたが、チップへの電源供給に必要な電圧要件は標準のSocket 7仕様とは異なります。P55C規格が制定される前に製造されたSocket 7対応のマザーボードのほとんどは、このCPUの正常な動作に必要なデュアル電圧レール（コア電圧2.8ボルト、入出力（I/O）電圧3.3ボルト）に準拠していません。Intelは、独自の電圧調整機能を備えたインターポーザーを搭載したOverDriveアップグレードキットでこの問題に対処しました。

ティラムック

Pentium MMXノートブックCPUは、CPUを内蔵するモバイルモジュールを採用していました。このモジュールは、CPUが直接接続されたプリント基板（PCB）で、小型フォームファクタに収められていました。このモジュールはノートブックのマザーボードにスナップ留めされ、通常はヒートスプレッダが取り付けられてモジュールと接触していました。しかし、250nmプロセス技術を採用したTillamook Mobile Pentium MMX（オレゴン州の都市にちなんで命名）では、このモジュールに430TXチップセットとシステムの512KBのスタティックランダムアクセスメモリ（SRAM）キャッシュメモリも搭載されていました。

モデルとバリエーション

Pentium および MMX テクノロジー搭載 Pentium
コードネーム P5 P54C P54C/P54CQS P54CS P55C ティラムック
製品コード 80501 80502 80503
プロセスサイズ 800 nm 600 nmまたは350 nm* 350 nm 350 nm（後に280 nm） 250 nm
ダイ面積（mm 2） 293.92 (16.7 x 17.6 mm) 148 @ 600 nm / 91 (後に 83) @ 350 nm 91（後に83） 141 @ 350 nm / 128 @ 280 nm 94.47 (9.06272 x 10.42416 mm)
トランジスタ数（百万） 3.10 3.20 3.30 4.50
ソケット ソケット4 ソケット5/7 ソケット7
パッケージ CPGA /CPGA+IHS CPGA/CPGA+IHS/ TCP * CPGA/TCP* CPGA/TCP* CPGA/ PPGAPPGA TCP* CPGA/PPGA/TCP* PPGA/TCP* MMC-1上のTCP/TCP
クロック速度（MHz） 60 66 75 90 100 120 133 150 166 200 120* 133* 150* 166 200 233 166 200 233 266 300
バス速度（MHz） 60 66 50 60 50 66 60 66 60 66 60 66 60 66
レベル1キャッシュサイズ 8 KB 2ウェイセットアソシアティブコードキャッシュ。8 KB 2ウェイセットアソシアティブライトバックデータキャッシュ 16 KB 4ウェイセットアソシアティブコードキャッシュ。16 KB 4ウェイセットアソシアティブライトバックデータキャッシュ
コア電圧 5.0 5.15 3.3 2.9* 3.3 2.9* 3.3 3.1* 2.9* 3.3 3.1* 2.9* 3.3 3.1* 2.9* 3.3 3.1* 2.9* 3.3 3.3 2.2* 2.45* 2.45* 2.8 2.45* 2.8 2.8 1.9 1.8* 1.8* 1.9 1.8* 1.9 2.0* 2.0*
I/O電圧 5.0 5.15 3.3 3.3 3.3 3.3 3.3 3.3 3.3 3.3 3.3 3.3 3.3 3.3 3.3 3.3 2.5 2.5 2.5 2.5 2.5
TDP（最大W） 14.6 (15.3) 16.0 (17.3) 8.0 (9.5) 6.0* (7.3*) 9.0 (10.6) 7.3* (8.8*) 10.1 (11.7) 600nmで8.0* (600nmで9.8*) 350nmで5.9* (350nmで7.6*) 12.8 (13.4) 7.1* (8.8*) 11.2 (12.2) 7.9* (9.8*) 11.6 (13.9) 10.0* (12.0*) 14.5 (15.3) 15.5 (16.6) 4.2* 7.8* (11.8*) 8.6* (12.7*) 13.1 (15.7) 9.0* (13.7*) 15.7 (18.9) 17.0 (21.5) 4.5 (7.4) 4.1* (5.4*) 5.0* (6.1*) 5.5* (7.0*) 7.6 (9.2) 7.6* (9.6*) 8.0*
紹介された 1993年3月22日 1994年10月10日 1994年3月7日 1995年3月27日 1995年6月12日 1996年1月4日 1996年6月10日 1996年10月20日 1997年5月19日 1997年1月8日 1997年6月2日 1997-08 1998-01 1999-01
* アスタリスクは、これらがラップトップ用のモバイル Pentium またはモバイル Pentium MMX チップとしてのみ利用可能であったことを示します。
MMX テクノロジー搭載 Pentium OverDrive
コードネーム P54CTB
製品コード ポッドMT60X150 PODPMT66X166 ポッドMT60X180 ポッドピーエムティー66X200
プロセスサイズ（nm） 350
ソケット ソケット5/7
パッケージ ヒートシンク、ファン、電圧レギュレータを備えた CPGA
クロック速度（MHz） 125 150 166 150 180 200
バス速度（MHz） 50 60 66 50 60 66
アップグレード ペンティアム75 ペンティアム90 Pentium 100および133 ペンティアム75 ペンティアム90、120、150 ペンティアム100、133、166
TDP（最大W） 15.6 15.6 15.6 18
電圧 3.3 3.3 3.3 3.3
MMXテクノロジ搭載Pentiumの組み込みバージョン
コードネーム P55C ティラムック
製品コード FV8050366200 FV8050366233 FV80503CSM66166 GC80503CSM66166 GC80503CS166EXT FV80503CSM66266 GC80503CSM66266
プロセスサイズ（nm） 350 250
クロック速度（MHz） 200 233 166 166 166 266 266
バス速度（MHz） 66 66 66 66 66 66 66
パッケージ PPGAPPGA PPGA BGABGA PPGA BGA
TDP（最大W） 15.7 17 4.5 4.1 4.1 7.6 7.6
電圧 2.8 2.8 1.9 1.8 1.8 1.9 2.0

競合他社

Pentiumの発表後、NexGen、[ 56 ] AMD、Cyrix、Texas Instrumentsなどの競合他社が1994年にPentium互換プロセッサを発表しました。 [ 57 ] CIOマガジンはNexGenのNx586を最初のPentium互換CPUと評し、[ 58 ] PC MagazineはCyrix 6x86を最初のPentium互換CPUと評しました。これに続いてAMD K5が発表されましたが、設計上の困難さから発売が遅れました。AMDは後にAMD K6の設計を支援するためNexGenを買収し、CyrixはNational Semiconductorに買収されました。[ 59 ] AMDとIntelの後発のプロセッサは、オリジナルのPentiumとの互換性を保っています。

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参照

参考文献

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Intelのデータシート

Intelのマニュアル

これらの公式マニュアルでは、Pentium プロセッサとその機能の概要について説明します。

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